Kazuei Hironaka 研究室
主宰者:Kazuei Hironaka
慶應義塾大学
AI 要約(直近 5 年の研究成果)
本研究室は、複数のFPGA(プログラマブルなハードウェア)ボードを高速な通信回線で直結し、1つの大規模な計算システムとして動作させるマルチFPGAクラスタの実現と応用を研究しています。特に5G基地局などの限られた電力供給下で高い計算性能と省電力性を両立させることを目指しており、エッジコンピューティング(データ処理を通信網の端で行う技術)のサーバとして機能させる開発を進めています。
研究の主な課題は、複数のFPGAボード間の効率的な通信ネットワーク設計と電力消費の最適化です。本研究室では、静的な時間分割多重化ネットワークとパケット交換を組み合わせたハイブリッドルータなど、リアルシステムを用いた詳細な電力・性能測定を通じて、ネットワークの活性化リンク数が全体消費電力に大きく影響することを明らかにしました。同時に、複数FPGAボード上での並列プログラミングを容易にするためのツール開発や、遺伝子配列検索やAI推論といった大規模な並列処理アプリケーションの実装に取り組んでいます。これらの研究成果により、省電力かつ柔軟に機能を変更できるエッジコンピューティングプラットフォームの構築を実現しています。
※ AI(Claude)が、公開されている論文要旨から研究の問い・手法・主要な発見を事実情報として抽出・再構成して自動生成しています。誤りを含む可能性があるため、正確性は研究室公式情報でご確認ください。
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関連研究室(8 件)
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研究成果(11 件)
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- DOI: https://doi.org/10.1587/transinf.2022pap0009
- DOI: https://doi.org/10.1109/coolchips54332.2022.9772675
- [2021] Improving the Performance of Circuit-Switched Interconnection Network for a Multi-FPGA SystemDOI: https://doi.org/10.1587/transinf.2021pap0002
- DOI: https://doi.org/10.1109/candar53791.2021.00020
- DOI: https://doi.org/10.1587/transinf.2020edp7165
- DOI: https://doi.org/10.1145/3468081.3471121
- DOI: https://doi.org/10.1109/coolchips52128.2021.9410322
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