Kensuke Iizuka 研究室
主宰者:Kensuke Iizuka
慶應義塾大学
AI 要約(直近 5 年の研究成果)
本研究室は、複数の集積回路チップ(FPGA)を高速な通信路で接続したクラスタシステムの設計と最適化に取り組んでいます。具体的には、5G基地局の近くに設置されるエッジコンピュータサーバーとして機能するマルチFPGAシステムを開発しており、限られた電力供給下で高い処理性能を実現することを目指しています。研究の問いは、複数チップ間の通信による電力消費を削減しながら、分散アプリケーション処理の効率を如何に高めるかにあります。
手法としては、実際のハードウェアボードを用いた電力消費の詳細な測定・分析と、最適化アルゴリズムによるタスク割り当てやネットワーク資源管理の自動化を行っています。また、画像認識や遺伝子配列解析といった具体的なアプリケーションをFPGAクラスタに実装し、パイプライン処理や量子化などの高速化技術を組み合わせることで実性能を評価しています。
主要な発見として、チップ間の通信リンクの本数がシステム全体の電力消費を支配する要因であり、リンクの利用状況よりも活性化の有無が重要であることを明らかにしています。さらに、時間的制約のある通信と通常の通信を同時に扱うハイブリッドなネットワーク設計により、リソース利用効率と応答性のバランスが改善されることを報告しています。
※ AI(Claude)が、公開されている論文要旨から研究の問い・手法・主要な発見を事実情報として抽出・再構成して自動生成しています。誤りを含む可能性があるため、正確性は研究室公式情報でご確認ください。
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研究成果(18 件)
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- DOI: https://doi.org/10.2197/ipsjtsldm.17.77
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- DOI: https://doi.org/10.1587/transinf.2022edp7230
- DOI: https://doi.org/10.1587/transinf.2022edp7175
- DOI: https://doi.org/10.1109/mcsoc57363.2022.00017
- DOI: https://doi.org/10.1587/transinf.2022pap0009
- DOI: https://doi.org/10.1109/candarw57323.2022.00074
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- DOI: https://doi.org/10.1109/coolchips54332.2022.9772675
- DOI: https://doi.org/10.1109/mcsoc51149.2021.00019
- [2021] Improving the Performance of Circuit-Switched Interconnection Network for a Multi-FPGA SystemDOI: https://doi.org/10.1587/transinf.2021pap0002
- DOI: https://doi.org/10.1109/candar53791.2021.00020
- DOI: https://doi.org/10.1587/transinf.2020edp7165
- DOI: https://doi.org/10.1145/3468081.3471121
- DOI: https://doi.org/10.1109/coolchips52128.2021.9410322
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